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(株)ベリフォア
■半導体の論理設計、検証およびツール開発業務をご担当頂きます。3〜4名のチームでプロジェクトに携わります。入社後はOJTで先輩と業務を行うので安心です。★チームは取引先及びプロジェクト毎に分れています。 仕様検討・作成→RTL実装→検証仕様作成→検証実施の一連の流れ 更に経験・実力・アイデアなどが伴えば、自社製品(検証ツールなど)開発にも携わっていただける可能性が開けます。 □作業環境:Linux/UNIX □言語:SystemVerilog、Verilog-HDL、VHDL、C/C++、Python □シュミレータ:EDA：VCS、IES、QuestaSIMをはじめフォーマルベリファイアなど各種EDA
正社員
京都市、その他京都府
年収350～ 800万円
【必須】■RTL（Verilog-HDL/VHDL）設計の経験（ASIC・FPGA等）・機能検証のご経験をお持ちの方(最低1年以上) 【歓迎】■仕様設計経験 ■英語での読解・記述能力（規格書・技術書等の読解）
◆単なる受託業務に終始せず、常にお客様の立場で解決策にこだわる姿勢が、確固たる信頼獲得につながっています。 ◆将来性◆最先端大規模SoCにおいてSystemVerilogを採用し、制約付きランダムテストやアサーションといった最新の検証技術を駆使した再利用可能な検証環境を構築・実装した経験が顧客から高い評価を得ています。 また、独自に開発した製品(検証ツール)の開発・販売にも事業展開を行っています(日本・海外)
